{"id":527,"date":"2018-11-08T16:38:13","date_gmt":"2018-11-08T15:38:13","guid":{"rendered":"https:\/\/www.informaticapremium.com\/blog\/?p=527"},"modified":"2019-01-16T10:29:44","modified_gmt":"2019-01-16T09:29:44","slug":"amd-zen-2-epyc-2-rome-7-nanometros","status":"publish","type":"post","link":"https:\/\/www.informaticapremium.com\/blog\/amd-zen-2-epyc-2-rome-7-nanometros\/","title":{"rendered":"AMD Zen 2 en EPYC 2 Rome 7 nan\u00f3metros"},"content":{"rendered":"<p>AMD lanzar\u00e1 al mercado en 2019 la nueva microarquitectura Zen 2 y los nuevos AMD EPYC 2 Rome fabricados en\u00a0 7 nan\u00f3metros para servers con 64 cores y 128 threads. Ayer, en el evento <a href=\"https:\/\/www.amd.com\/en\/events\/next-horizon\">Next Horizon<\/a> di\u00f3 a conocer sus nuevas tecnolog\u00edas, datos que voy a\u00a0 analizar en este art\u00edculo.<\/p>\n<p>Durante 2019 AMD tambi\u00e9n desplegar\u00e1 los cores Zen 2 en todos los segmentos del mercado:<\/p>\n<ul>\n<li>Ryzen 2 con cores Zen 2 de 7 nm para sobremesa con hasta 16 cores y 32 threads y 16 MB de cach\u00e9 L3.<\/li>\n<li>APUs Ryzen 2 con cores Zen 2 de 7 nm con 8 cores y 16 threads con 8 MB L3 para port\u00e1tiles con GPUs Vega tambi\u00e9n de 7 nm.<\/li>\n<\/ul>\n<h2>Los nuevos AMD EPYC 2 Rome 7 nm<\/h2>\n<p>Simplemente brutal. Los nuevos procesadores EPYC 2 merecen sin duda este calificativo, nada m\u00e1s y nada menos que 64 cores f\u00edsicos con SMT para 128 threads de procesamiento simult\u00e1neo por socket&#8230; Incre\u00edble, formados por 9 chips (!!) y disponibles ya en 2019.<\/p>\n<p>Y AMD EPYC 2 Rome no solo proporciona cambios a nivel de n\u00famero de cores o su nueva tecnolog\u00eda de fabricaci\u00f3n TSMC de 7 nan\u00f3metros. Adem\u00e1s evoluciona hacia buses PCIe 4.0 (con doble ancho de banda que los actuales PCIe 3.0) y ser\u00e1 compatible con el actual socket SP3 \/ LGA 4094.<\/p>\n<p><!--more--><\/p>\n<p><img decoding=\"async\" loading=\"lazy\" class=\"size-full wp-image-577\" style=\"font-weight: bold; background-color: transparent; text-align: inherit; --darkreader-inline-bgcolor: transparent;\" src=\"https:\/\/i0.wp.com\/www.informaticapremium.com\/blog\/wp-content\/uploads\/2018\/11\/EPYC2-photo.jpg?resize=800%2C640&#038;ssl=1\" alt=\"AMD EPYC2 7 nm 64 cores 128 threads\" width=\"800\" height=\"640\" data-darkreader-inline-bgcolor=\"\" srcset=\"https:\/\/i0.wp.com\/www.informaticapremium.com\/blog\/wp-content\/uploads\/2018\/11\/EPYC2-photo.jpg?w=800&amp;ssl=1 800w, https:\/\/i0.wp.com\/www.informaticapremium.com\/blog\/wp-content\/uploads\/2018\/11\/EPYC2-photo.jpg?resize=300%2C240&amp;ssl=1 300w, https:\/\/i0.wp.com\/www.informaticapremium.com\/blog\/wp-content\/uploads\/2018\/11\/EPYC2-photo.jpg?resize=768%2C614&amp;ssl=1 768w\" sizes=\"(max-width: 709px) 85vw, (max-width: 909px) 67vw, (max-width: 984px) 61vw, (max-width: 1362px) 45vw, 600px\" data-recalc-dims=\"1\" \/><\/p>\n<p>AMD EPYC2 7 nm 64 cores 128 threadsEPYC 2 ser\u00e1 la primera CPU x86 en integrar buses PCIe 4.0 que doblan en velocidad a los que actualmente integran Intel y AMD en sus CPUs.<\/p>\n<blockquote><p>La arquitectura del procesador AMD EPYC 2 Rome apuesta por una renovaci\u00f3n total en su implementaci\u00f3n general y rompe con el esquema de dise\u00f1o del procesador EPYC de primera generaci\u00f3n.<\/p><\/blockquote>\n<figure id=\"attachment_528\" aria-describedby=\"caption-attachment-528\" style=\"width: 494px\" class=\"wp-caption aligncenter\"><img decoding=\"async\" loading=\"lazy\" class=\"size-full wp-image-528\" src=\"https:\/\/i0.wp.com\/www.informaticapremium.com\/blog\/wp-content\/uploads\/2018\/11\/AMD-EPYC.jpg?resize=494%2C345&#038;ssl=1\" alt=\"Procesador AMD EPYC 14 nm formado por 4 dies Zeppelin\" width=\"494\" height=\"345\" srcset=\"https:\/\/i0.wp.com\/www.informaticapremium.com\/blog\/wp-content\/uploads\/2018\/11\/AMD-EPYC.jpg?w=494&amp;ssl=1 494w, https:\/\/i0.wp.com\/www.informaticapremium.com\/blog\/wp-content\/uploads\/2018\/11\/AMD-EPYC.jpg?resize=300%2C210&amp;ssl=1 300w\" sizes=\"(max-width: 494px) 85vw, 494px\" data-recalc-dims=\"1\" \/><figcaption id=\"caption-attachment-528\" class=\"wp-caption-text\">Primera generaci\u00f3n: Procesador AMD EPYC 14 nm formado por 4 dies Zeppelin<\/figcaption><\/figure>\n<p>El actual AMD EPYC 14 nm (32 cores, 64 threads) es un procesador formado por 4 dies Zeppelin 14 nm (2 CCX de 4 cores: 8 cores, 16 threads y 2 cach\u00e9s L3 de 8 MB).<\/p>\n<p>Para un an\u00e1lisis detallado recomiendo mi art\u00edculo sobre <a href=\"https:\/\/www.informaticapremium.com\/blog\/amd-ryzen-7-8c-16t-4ghz\/\" target=\"_blank\" rel=\"noopener\">AMD Ryzen<\/a>.<\/p>\n<p>Los mismos dies utilizados en las CPU AMD Ryzen 8c \/ 16T, comunicados en EPYC entre s\u00ed mediante enlaces bidireccionales Infinity Fabric:<\/p>\n<figure id=\"attachment_529\" aria-describedby=\"caption-attachment-529\" style=\"width: 702px\" class=\"wp-caption aligncenter\"><img decoding=\"async\" loading=\"lazy\" class=\"size-full wp-image-529\" src=\"https:\/\/i0.wp.com\/www.informaticapremium.com\/blog\/wp-content\/uploads\/2018\/11\/EPYC-infinity-fabric.png?resize=702%2C541&#038;ssl=1\" alt=\"AMD EPYC Infinity Fabric links\" width=\"702\" height=\"541\" data-recalc-dims=\"1\" \/><figcaption id=\"caption-attachment-529\" class=\"wp-caption-text\">Primera generaci\u00f3n: AMD EPYC 14 nm con los links Infinity Fabric<\/figcaption><\/figure>\n<p>EPYC 2 mantiene el octa channel DDR4 pero esta vez con frecuencias de trabajo aumentadas. Posiblemente a DDR4 3200 o superior.<\/p>\n<h3>AMD EPYC 2 Rome: Dise\u00f1o integrado vs. distribuido<\/h3>\n<blockquote><p>AMD EPYC 2 Rome 7 nm cambia a\u00a0 un <strong>dise\u00f1o integrado<\/strong> de <strong>8 controladoras DDR4 en el IO Chip<\/strong> rompiendo con el <strong>dise\u00f1o\u00a0 distribuido\u00a0<\/strong>de 2 controladoras DDR4 en cada die Zeppelin en EPYC 14 nm para un id\u00e9ntico total de 8 canales.<\/p><\/blockquote>\n<h3>El IO chip de 14 nm de AMD EPYC 2 Rome<\/h3>\n<p>La pieza angular del dise\u00f1o del EPYC2 reside en el <strong>enorme IO chip (Input &#8211; output)<\/strong>\u00a0fabricado en 14 nm que domina el espacio central del procesador y que<strong> integra todas las interfaces de interconexi\u00f3n del procesador<\/strong>:<\/p>\n<ul>\n<li>8 controladoras DDR4.<\/li>\n<li>128 v\u00edas PCIe 4.0.<\/li>\n<li>8 enlaces bidireccionales Infinity Fabric para conexi\u00f3n de los 8 Chiplets de computaci\u00f3n (Compute Chips) de 7 nm.<\/li>\n<li>Los enlaces Infinity Fabric para interconexi\u00f3n con el segundo socket (4 u 8).<\/li>\n<\/ul>\n<figure id=\"attachment_578\" aria-describedby=\"caption-attachment-578\" style=\"width: 800px\" class=\"wp-caption aligncenter\"><img decoding=\"async\" loading=\"lazy\" class=\"size-full wp-image-578\" src=\"https:\/\/i0.wp.com\/www.informaticapremium.com\/blog\/wp-content\/uploads\/2018\/11\/EPYC2-photo-anotada.jpg?resize=800%2C641&#038;ssl=1\" alt=\"Chiplets AMD EPYC2 7 nm 64 cores 128 threads\" width=\"800\" height=\"641\" srcset=\"https:\/\/i0.wp.com\/www.informaticapremium.com\/blog\/wp-content\/uploads\/2018\/11\/EPYC2-photo-anotada.jpg?w=800&amp;ssl=1 800w, https:\/\/i0.wp.com\/www.informaticapremium.com\/blog\/wp-content\/uploads\/2018\/11\/EPYC2-photo-anotada.jpg?resize=300%2C240&amp;ssl=1 300w, https:\/\/i0.wp.com\/www.informaticapremium.com\/blog\/wp-content\/uploads\/2018\/11\/EPYC2-photo-anotada.jpg?resize=768%2C615&amp;ssl=1 768w\" sizes=\"(max-width: 709px) 85vw, (max-width: 909px) 67vw, (max-width: 984px) 61vw, (max-width: 1362px) 45vw, 600px\" data-recalc-dims=\"1\" \/><figcaption id=\"caption-attachment-578\" class=\"wp-caption-text\">Chiplets AMD EPYC2 7 nm 64 cores 128 threads<\/figcaption><\/figure>\n<p>A este IO chip se conectan con enlaces Infinity Fabric los 8 dies (Chiplets) de 7 nm compuestos de:<\/p>\n<ul>\n<li>8 cores (16 threads SMT) Zen 2 con cach\u00e9s Loi, L1i, L1d y L2 unificada 512 KB<\/li>\n<li>La cach\u00e9 L3 (de 16 MB \/ 16 way muy probablemente)<\/li>\n<li>La circuiter\u00eda de interconexi\u00f3n Infinity Fabric con el IO Chip<\/li>\n<\/ul>\n<p>El IO Chip de 14 nm es una inc\u00f3gnita. Mi intuici\u00f3n me dice que hay algo m\u00e1s ah\u00ed&#8230; Abogo por quiz\u00e1s un <strong>probe filter<\/strong> o una cach\u00e9 L4.<\/p>\n<p>Su gran superficie est\u00e1 alimentando rumores diversos. Es tan desmesurado su tama\u00f1o que se especula incluso con la integraci\u00f3n de memoria eDRAM&#8230;<\/p>\n<h2>La microarquitectura AMD Zen 2<\/h2>\n<p>Los procesadores AMD EPYC 2 Rome integran en 8 Chiplets formados cada uno por 8 cores Zen 2 de 7 nan\u00f3metros\u00a0 derivados de los actuales cores Zen 14 nm y Zen+ 12 nm.<\/p>\n<p>Estos aportan varias mejoras, algunas muy importantes, respecto a los actuales cores Zen y Zen+. Los cambios conocidos a fecha de hoy comprenden:<\/p>\n<ul>\n<li>Doble ancho de banda de 256 bit en las unidades load\/store.<\/li>\n<li>La cach\u00e9 L1i (instrucciones) se doblar\u00e1 en BW para dar servicio a las instrucciones AVX2 de 256 bit.<\/li>\n<li>Veremos si se toca la asociatividad o su tama\u00f1o f\u00edsico.<\/li>\n<li>La cach\u00e9 L0i, tambi\u00e9n llamada OpCache, se ampl\u00eda desde los 2 KB actuales probablemente a 4 KB y se dobla su ancho de banda a 256 bit.<\/li>\n<li>Mejoran los algoritmos de prefetch a L1 y L2.<\/li>\n<li>Se itera en el subsistema de branch prediction mediante redes neuronales mejorando la tasa de aciertos y el fetching de instrucciones.<\/li>\n<li>Retoques leves en la cach\u00e9 L2, no creo que cambien los 512 KB actuales, quiz\u00e1s se reduzca la latencia.<\/li>\n<li>La cach\u00e9 L3 probablemente sea com\u00fan para los 8 cores de cada uno de los chiplets de 7 nm y su tama\u00f1o ser\u00e1 de 16 o 32 MB. 16 MB ser\u00eda suficiente y posiblemente el sweet spot. Asociatividad 16 v\u00edas, 32 en el caso de 32 MB.<\/li>\n<li>Aumenta el ancho de banda de dispatch \/ retire del core.<\/li>\n<li>En la FPU se ampl\u00edan las unidades de proceso FMUL \/ FADD \/ FMA en la parte vectorizada a unidades AVX2 nativas de 256 bit con datapaths tambi\u00e9n de 256 bit.<\/li>\n<\/ul>\n<blockquote><p>AMD Zen 2 aporta mejoras muy importantes en el terreno IPC, cifrados en una mejora de un 15% en enteros y de un 100% en cargas vectorizadas AVX2.<\/p><\/blockquote>\n<h2>Intel 10 nm. Retrasos y cancelaciones<\/h2>\n<p>Intel con su l\u00ednea Xeon Scalable, a dia de hoy, <strong>no tiene una respuesta v\u00e1lida a EPYC2\u00a0 Rome 7 nm<\/strong> para 2019 y tampoco contra las CPUs Ryzen 2 que llegar\u00e1n por esas fechas.<\/p>\n<blockquote><p>A lo largo de 2019 <strong>Intel no va a poder hacer frente a las nuevas proposiciones de AMD en el segmento Server<\/strong>. Un aut\u00e9ntico hito no visto desde la \u00e9poca de los AMD Opteron Athlon 64 en el ya lejano a\u00f1o 2004.<\/p><\/blockquote>\n<p>Intel ambicion\u00f3 llegar a los 100 MT\/mm\u00b2 (millones de transistores por mm\u00b2) y ese objetivo le est\u00e1 dando muchos problemas que reducen el n\u00famero de chips v\u00e1lidos que salen de sus l\u00edneas de fabricaci\u00f3n de 10 nm (yields muy reducidos).<\/p>\n<p>El proceso de 10 nm de Intel, muy ambicioso en su dise\u00f1o, lleva a\u00f1os de retrasos y cancelaciones. Veremos finalmente qu\u00e9 proceso (si es el original de 10 nm u uno con reglas m\u00e1s relajadas) llega a productos comerciales.<\/p>\n<figure id=\"attachment_540\" aria-describedby=\"caption-attachment-540\" style=\"width: 674px\" class=\"wp-caption aligncenter\"><img decoding=\"async\" loading=\"lazy\" class=\"size-full wp-image-540\" src=\"https:\/\/i0.wp.com\/www.informaticapremium.com\/blog\/wp-content\/uploads\/2018\/11\/Intel_10nm_3.jpg?resize=674%2C460&#038;ssl=1\" alt=\"Intel 10 scaling\" width=\"674\" height=\"460\" srcset=\"https:\/\/i0.wp.com\/www.informaticapremium.com\/blog\/wp-content\/uploads\/2018\/11\/Intel_10nm_3.jpg?w=674&amp;ssl=1 674w, https:\/\/i0.wp.com\/www.informaticapremium.com\/blog\/wp-content\/uploads\/2018\/11\/Intel_10nm_3.jpg?resize=300%2C205&amp;ssl=1 300w\" sizes=\"(max-width: 709px) 85vw, (max-width: 909px) 67vw, (max-width: 984px) 61vw, (max-width: 1362px) 45vw, 600px\" data-recalc-dims=\"1\" \/><figcaption id=\"caption-attachment-540\" class=\"wp-caption-text\">Intel 10 scaling<\/figcaption><\/figure>\n<p>Y digo esto por lo siguiente:<\/p>\n<p>Dadas las insalvables dificultades para mejorar los yields en 10 nan\u00f3metros y hacer de este proceso algo viable comercialmente, parece que est\u00e1 relajando varias de sus m\u00e9tricas.<\/p>\n<p>Por ello es posible que el proceso que veremos plasmado en productos no sea aquel de los c\u00e9lebres 100 MT\/mm\u00b2.<\/p>\n<p>Seg\u00fan AMD y TSMC el proceso de fabricaci\u00f3n TSMC de 7 nan\u00f3metros tiene mejor relaci\u00f3n performance \/ watt que el futuro Intel de 10 nm:<\/p>\n<figure id=\"attachment_579\" aria-describedby=\"caption-attachment-579\" style=\"width: 800px\" class=\"wp-caption aligncenter\"><img decoding=\"async\" loading=\"lazy\" class=\"size-full wp-image-579\" src=\"https:\/\/i0.wp.com\/www.informaticapremium.com\/blog\/wp-content\/uploads\/2018\/11\/TSMC-7nm-vs-Intel-10-nm.jpg?resize=800%2C325&#038;ssl=1\" alt=\"El proceso TSMC 7 nm vs Intel 10 nm\" width=\"800\" height=\"325\" srcset=\"https:\/\/i0.wp.com\/www.informaticapremium.com\/blog\/wp-content\/uploads\/2018\/11\/TSMC-7nm-vs-Intel-10-nm.jpg?w=800&amp;ssl=1 800w, https:\/\/i0.wp.com\/www.informaticapremium.com\/blog\/wp-content\/uploads\/2018\/11\/TSMC-7nm-vs-Intel-10-nm.jpg?resize=300%2C122&amp;ssl=1 300w, https:\/\/i0.wp.com\/www.informaticapremium.com\/blog\/wp-content\/uploads\/2018\/11\/TSMC-7nm-vs-Intel-10-nm.jpg?resize=768%2C312&amp;ssl=1 768w\" sizes=\"(max-width: 709px) 85vw, (max-width: 909px) 67vw, (max-width: 984px) 61vw, (max-width: 1362px) 45vw, 600px\" data-recalc-dims=\"1\" \/><figcaption id=\"caption-attachment-579\" class=\"wp-caption-text\">El proceso TSMC 7 nm vs Intel 10 nm<\/figcaption><\/figure>\n<p>Siendo realista, espero procesadores Intel de 10 nm en masa para finales de 2019 o inicios de 2020. Sin duda, en ese momento Intel tendr\u00e1 excelentes CPUs en todos los segmentos y ser\u00e1 altamente competitiva.<\/p>\n<h2>Conclusiones server AMD EPYC 2 Rome<\/h2>\n<p>EPYC 2 Rome, unificando toda la interconexi\u00f3n en el IO Chip aportar\u00e1 una gran simplicidad de cara al manejo de memoria. Cada procesador EPYC2 Rome ser\u00e1 un \u00fanico NUMA Node.<\/p>\n<p>Se reducir\u00e1 radicalmente el tr\u00e1fico de coherencia en entornos server y con ello mejorar\u00e1 importantemente la escalabilidad de los sistemas. Todos los chiplets tendr\u00e1n acceso a todos los canales DDR4 y\u00a0 las latencias ser\u00e1n id\u00e9nticas entre los 64 cores.<\/p>\n<blockquote><p>Todos los grandes proveedores Cloud integrar\u00e1n procesadores AMD EPYC 2 basados en cores Zen 2 a lo largo de 2019. Una victoria estrat\u00e9gica de AMD que aspira a ganar cuota de mercado en todos los sectores a Intel.<\/p><\/blockquote>\n<p>La competencia ser\u00e1 muy beneficiosa para el mercado, el consumidor y el avance de la tecnolog\u00eda y microarquitectura de procesadores. Sin duda.<\/p>\n<p>Desde la llegada de AMD Ryzen Intel se ha visto obligado a\u00a0 reducir precios y se ha decidido por fin a lanzar CPUs de mayor n\u00famero de cores para los mercados mainstream desktop, porta\u00e1tiles y tambi\u00e9n en la gama alta HEDT con los Skylake-X de hasta 18 cores (por ahora).<\/p>\n","protected":false},"excerpt":{"rendered":"<p>AMD lanzar\u00e1 al mercado en 2019 la nueva microarquitectura Zen 2 y los nuevos AMD EPYC 2 Rome fabricados en\u00a0 7 nan\u00f3metros para servers con 64 cores y 128 threads. Ayer, en el evento Next Horizon di\u00f3 a conocer sus nuevas tecnolog\u00edas, datos que voy a\u00a0 analizar en este art\u00edculo. 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